어떻게 하면 정기적으로 블로그에 글을 쓸 수 있을까?어렵다...
unipro 2.0 스펙을 공부하던 도중 unrolling IDLE sequence를 언급한 문단에서 의문이 떠올랐다. spec 어디에서도 unrolling이라는 단어를 사용하지 않았기 때문에 의미를 이해하지 못했다. 해당 spec을 제정한 MIPI alliance의 bugzilla라는 홈페이지에서 해당 문장이 포함되기까지의 논의 과정를 발견할 수 있었다. 1. 정상적인 IDLE sequence라면 mk3 부터 시작해서 로 종료될 것이다. 2. 하지만 IDLE sequence 전송 중 발생한 오류로 인해 의도하지 않은 symbol으로 바뀌어 전송될 수 있다. 2-1. 중간에 발생한 오류라면 IDLE sequence이 종료되지 않으며 (IDLE sequence에 대한 처리인 unrolling도 계속 수행)..
외부 표현 포트 // with controller input directory_start output directory_done output hit_state -> hit_state에 따라 컨트롤러가 rsp_valid, req_ready를 보낼 것인지 확인함. // with core input [31:0] directory_address input [31:0] directory_input_data input [31:0] directory_wren output [31:0] directory_output_data // LRU는 디렉토리 내부에 내장하기 // with WB output w_address; output w_data; input w_done; // with FETCH output f_address..
외부 기능 0->1->0 펄스를 세는 기능을 함. 액티브엣지 시점에서 외부 포트 input source output cnt 동작 1. source가 1이면 internal_cnt가 1이 할당됨. 2. source가 0이되면 internal_cnt가 1인지 확인하고 그렇다면 cnt값을 1만큼 증가시킴. 그리고 다음 펄스를 위해 internal_cnt를 0으로 초기화시킴. // Code your design here module pulse_counter( input source, output reg [3:0] cnt, input clk, input rstn ); reg internal_cnt; always @(posedge clk or negedge rstn) begin if (!rstn) begin int..
외부 fetch 포트 // between controller input fetch_start output fetch_done // between directory input [31:0] fetch_address output [31*8:0] fetch_cache_line output fetch_directory_done // between sram output req_valid; output req_wren; output [31:0] req_addrss; input req_ready; input rsp_valid; input [31:0] rsp_data; output rsp_ready; wb 기능 1. controller에서 fetch_start가 들어오면 일련의 동작을 시작한다. 2. 캐시 디렉토리로부터..
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